moduleseg(IN,OUT);input[1:0]IN;output[3:0]OUT;reg[3:0]OUT;always@(IN)begincase(IN)2’b00:OUT=8’b11102’b01:OUT=8’b1101;2’b10:OUT=8’b1011;2’b11:OUT=8’b0111;endcaseendendmodule上述代码描述的是()
发布于 2021-03-29 16:06:25
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